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首页 > 大众科技 > 基于CPLD的高频电路多功能时钟模块设计

基于CPLD的高频电路多功能时钟模块设计

Design of Multi-function Clock Module In the High Frequency Circuit Using CPLD Technique

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摘要文章介绍了一种基于CPLD的高频电路的多路不同频率同步时钟输出模块的设计方法，采用单一高频时钟作为时钟源输入，通过CPLD的分频电路设计实现输出多路不同频率同步时钟，利用有限状态基设计实现CPLD的外部控制接口，实现对CPLD输出时钟频率的任意调节。有效满足复杂的高频电路设计中需要提供多路不同频率同步时钟的要求。

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作者 杨龙 [1] 杨威 [2] 学术成果认领
作者单位 东软派斯通医疗系统有限公司,辽宁沈阳,110179 [1] 东软集团（大连）有限公司,辽宁大连,116085 [2]
关键词 CPLD时钟分频有限状态基CPLDClock DivisionFinite State Machines
分类号 TN77
栏目名称
电力与机械
DOI 10.3969/j.issn.1008-1151.2012.01.096
发布时间 2012-04-28（万方平台首次上网日期，不代表论文的发表时间）
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大众科技

大众科技

2012年1期

233-235页

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